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有源相控阵射频前端模块硬件设计 | |
论文目录 | |
| 摘要 | 第1-5页 |
| abstract | 第5页 |
| 第一章 绪论 | 第9-16页 |
| 1.1 研究背景 | 第9-11页 |
| 1.1.1 课题背景 | 第9-10页 |
| 1.1.2 理论意义与工程应用价值 | 第10-11页 |
| 1.2 研究现状 | 第11-12页 |
| 1.2.1 国外研究和发展现状 | 第11-12页 |
| 1.2.2 国内研究和发展现状 | 第12页 |
| 1.3 主要研究内容及设计指标 | 第12-14页 |
| 1.3.1 研究内容 | 第13页 |
| 1.3.2 设计指标 | 第13-14页 |
| 1.4 论文的组织结构 | 第14-16页 |
| 第二章 系统组成和工作原理 | 第16-26页 |
| 2.1 有源相控阵技术综述 | 第16-18页 |
| 2.2 相控阵天线扫描原理 | 第18-20页 |
| 2.3 提高相控阵收发正确率的方法 | 第20-22页 |
| 2.3.1 保持相位一致性 | 第20-21页 |
| 2.3.2 抑制副瓣信号 | 第21-22页 |
| 2.4 系统工作流程 | 第22-24页 |
| 2.4.1 接收流程 | 第22-23页 |
| 2.4.2 发射流程 | 第23-24页 |
| 2.4.3 自检流程 | 第24页 |
| 2.4.4 校准流程 | 第24页 |
| 2.5 本章小结 | 第24-26页 |
| 第三章 相控阵前端硬件设计 | 第26-50页 |
| 3.1 前端设计方案 | 第26-30页 |
| 3.1.1 波束形成网络 | 第28-29页 |
| 3.1.2 相控阵天线数量选择 | 第29-30页 |
| 3.2 相控阵前端组件电路设计 | 第30-45页 |
| 3.2.1 TR收发电路设计 | 第31-39页 |
| 3.2.2 和差激励和功分网络电路设计 | 第39-43页 |
| 3.2.3 校准电路设计 | 第43-44页 |
| 3.2.4 副瓣抑制通道电路设计 | 第44-45页 |
| 3.3 控制模块电路设计 | 第45-49页 |
| 3.3.1 FPGA控制单元 | 第45-46页 |
| 3.3.2 监控单元 | 第46-49页 |
| 3.4 本章小结 | 第49-50页 |
| 第四章 控制程序设计与实现 | 第50-65页 |
| 4.1 功能需求分析 | 第50-53页 |
| 4.1.1 设计步骤 | 第50-51页 |
| 4.1.2 实现功能 | 第51-52页 |
| 4.1.3 工作流程 | 第52-53页 |
| 4.2 控制程序结构 | 第53-58页 |
| 4.2.1 信号格式 | 第53-54页 |
| 4.2.2 信号传递方式 | 第51-57页 |
| 4.2.3 校验方式 | 第57-58页 |
| 4.3 收发控制 | 第58-61页 |
| 4.4 校准实现 | 第61-62页 |
| 4.5 检测功能 | 第62-64页 |
| 4.5.1 检波测量 | 第62-63页 |
| 4.5.2 温度检测 | 第63-64页 |
| 4.6 本章小结 | 第64-65页 |
| 第五章 系统测试 | 第65-74页 |
| 5.1 系统测试分析 | 第65-66页 |
| 5.2 测试方法与结果 | 第66-73页 |
| 5.2.1 接收通道增益 | 第66-67页 |
| 5.2.2 移相步进 | 第67-68页 |
| 5.2.3 通道相位一致性 | 第68-69页 |
| 5.2.4 发射峰值功率 | 第69-70页 |
| 5.2.5 接收译码灵敏度及动态范围 | 第70-71页 |
| 5.2.6 天线方位面的方向图 | 第71-73页 |
| 5.3 本章小结 | 第73-74页 |
| 第六章 全文总结与展望 | 第74-76页 |
| 6.1 总结 | 第74-75页 |
| 6.2 展望 | 第75-76页 |
| 致谢 | 第76-77页 |
| 参考文献 | 第77-79页 |
| 攻读硕士学位期间取得的成果 | 第79页 |
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